高速设计是电气工程师可以承担的最具挑战性的任务之一。许多因素可能影响高速信号的响应方式。一个误解是高速设计是系统时钟频率的功能。事实并非如此。实际上,高速是由上升时间、PCB堆叠中的阻抗控制、走线宽度和终端决定的。
更快的切换速度对工程师和PCB设计师来说基本上意味着两件事:
信号完整性问题
反射、串扰等。
通过控制阻抗布线、终端和PCB堆叠来实现信号完整性目标。
时序约束
确保多个信号几乎同时到达它们的目的地引脚
匹配信号路径的路由长度
在过去,工程师们不得不通过在电子表格中跟踪所有内容来处理信号完整性和时间约束问题。这使他们能够跟踪每个网络的每个单独段长、通孔深度、电阻长度和引脚长度。将每个网络的所有这些相加,然后在需要的地方添加信号长度,这使他们能够使组中所有网络的长度相等。这是一种过时的长度匹配方法,既繁琐又耗时。
如果你能自动定位相关设计规则,如长度和匹配长度,而不必浪费时间在电子表格中跟踪数据呢?下载我们的免费高速设计和xSignals®白皮书,学习如何自动化你的高速设计流程。
Pierre现任Altium北美区销售应用工程师。他曾在哈佛大学维斯生物仿生机器人研究所从事机电设计和制造工作,是一名机电工程师。Pierre最近加入了Altium的工程团队,并继续致力于微型PCB,CNC机器和IOS应用程序开发的设计和制造。
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