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直流阻断滤波器设计 1 min Altium Designer Projects 电气工程师 PCB 设计工程师 电气工程师 电气工程师 PCB 设计工程师 PCB 设计工程师 本文解释了如何为示波器输入通道设计和模拟直流阻断滤波器。了解如何选择组件、布局优化、模拟结果以及现实世界验证，以创建适用于各种硬件设计需求的高性能滤波器。 阅读文章
使用生成式AI为实验室仪器增添物联网功能 使用生成式AI为实验室仪器增添物联网功能 4 min Altium Designer Projects PCB 设计工程师 电气工程师 PCB 设计工程师 PCB 设计工程师 电气工程师 电气工程师 在本文中，Ari Mahpour 向您展示如何利用生成式 AI 创建一个完整的网络服务，以控制您的实验室仪器 阅读文章
如何构建自定义GPT动作与您的硬件通信 如何构建自定义GPT动作与您的硬件对话 1 min Altium Designer Projects 电气工程师 电气工程师 电气工程师 在本文中，Ari Mahpour 向您展示如何创建自定义 GPT Actions，以便与您在家中或实验室里的硬件连接 阅读文章
Pi MX8 Chapter IV Pi.MX8 Project - Board Layout Part 2 10 min Altium Designer Projects In the previous update, we looked at defining a suitable layerstack for the module as well as adding the fanout 阅读文章
Gemini与ChatGPT对比 Gemini与ChatGPT：谁能写出更好的代码？ 4 min Altium Designer Projects 电气工程师 电气工程师 电气工程师 在这篇文章中，Ari Mahpour 进行了一对一的编码比较，对比了ChatGPT的GPT4模型和Google最强大的模型Gemini Advanced。 阅读文章
Pi. MX8_第三章 Pi. MX8 项目 - 板布局 第1部分 1 min Altium Designer Projects 欢迎来到Pi.MX8开源计算机模块项目的第三部分！在这个系列文章中，我们将深入探讨基于NXP的i.MX8M plus处理器的系统模块的设计和测试。 在 上次更新中，我们查看了模块的原理图结构，并开始准备初步的元件布局。现在我们已经放置了元件，我们对设计的密度和这对层叠的要求有了一个好的了解。今天，我们将选择一个合适的层叠并开始布线第一条轨迹。 定义层叠 基于元件布局和一些战略因素，我们可以决定在设计中向前使用哪种PCB技术和哪种层叠。让我们首先看看元件密度： 顶层元件布局 初步的元件布局揭示了一个中等的整体设计密度。所有的活动元件都位于板的顶面，而底面主要包含去耦电容和其他被动电路。因此，板的底面相对空旷，为我们留下了充足的布线空间。然而，目标是为将要实施的额外功能分配这些空间，因为Pi.MX8模块旨在作为一个可以根据特定请求更新和扩展的平台。 底层元件布局 观察靠近板对板连接器的元件布局时，我们注意到许多元件直接放置在连接器的对面板上。如果我们决定只使用连接顶层到底层的标准通孔VIAs，那么在这些区域内我们将无法放置任何VIAs。为了打通板对板连接器上的所有引脚，并有效地布线连接器对面的活动电路，我们需要设计一种不仅仅依赖于通孔VIAs的方法。为此，我们将需要使用HDI层叠。 使用HDI层叠使得在后期扩展模块功能变得更加容易，因为我们不必一定要使用通孔VIAs来连接额外的元件，因此不必过多干预已建立的布线和元件布局。 对于Pi.MX8模块，我们将使用2+N+2层层叠。这是IPC-2226标准中定义的III型层叠，也是最常用的HDI层叠之一。 这种类型的层叠在制造过程中使用两个连续的层压步骤，以允许微通孔VIAs连接最外层的三层。一个埋藏的VIA用于连接不是连续制造过程一部分的核心层叠。这种类型层叠中使用的预浸料和预浸料厚度取决于PCB提供商的制造能力。连续层压预浸料的选择厚度受到微VIA的纵横比限制。与机械钻孔VIAs不同，微VIAs是通过使用短脉冲激光在预浸料中打孔创建的。通常使用的VIA直径在0.08mm到0.15mm之间。适合大规模制造的纵横比通常在0.6:1 – 0.8:1范围内。 薄的预浸料将确保不违反纵横比要求，同时为给定阻抗控制的走线减少走线宽度。对于只有一个参考平面的顶层或底层上的简单微带线来说，这不是问题。然而，我们必须小心第一个接地平面下面的嵌入式带状线，因为带状线上下到参考平面的短距离可能会导致某些阻抗控制接口的走线非常窄。 Pi.MX8板的最终层叠是与PCB制造商合作创建的，如下所示： Pi.MX8层叠 总体而言，该模块将基于10层堆叠构建。顶层、L2层、L7层和底层将被用作信号层。L1层、L3层、L6层和L8层将被用作地平面。剩下的两层L4和L5将作为电源层。电源层是使用仅18μm厚度的薄箔构建的。我们必须密切关注这些层的IR降。电源层与相邻的地平面紧密耦合，仅有75μm的预浸料将这些层分隔开。这导致额外的平面电容，这对于在高频下提供低PDN阻抗非常有益。一旦我们完成布局，我们将通过仿真验证PDN行为。 关于这个堆叠的另一个重要方面是，我们将仅使用交错的微通孔而不是堆叠的微通孔。这意味着微通孔不能直接叠放在彼此之上，而必须至少以0.35mm的中心到中心的间距错开。使用交错的通孔使得连续层的注册更加容易，这降低了一些PCB提供商的制造成本。对于使用两个以上微通孔程序的HDI堆叠，也推荐使用这种方法来增加微通孔的可靠性。使用交错微通孔的缺点是需要额外的空间来满足最小偏移要求。在管理邻近走线的返回路径时，还需要考虑地平面中创建的空隙。 阅读文章
LAE 第2部分 设计阶段 - 盖子组件电子部件第二部分 1 min Altium Designer Projects 欢迎回到开源笔记本电脑项目系列！到目前为止，我们已经讨论了盖板电子组件的功能和部件选择，我们已经更仔细地查看了原理图捕获，并且我们已经为PCB布局设计准备了项目。 在这次更新中，我们将解决网络摄像头板的PCB设计，面临一些预期的挑战；例如，处理板子整体的小尺寸因素或者打破微小的网络摄像头图像传感器。 图像传感器封装 让我们开始更仔细地看看网络摄像头图像传感器和匹配的脚印。图像传感器OV2740有几种封装，图像传感器通常作为裸片销售，直接粘贴或焊接在PCB上。然后使用薄金属键合线将传感器键合到板上，以打开所有必要的信号。 OV2740芯片键合到PCB上 使用裸片而不是完整封装的传感器有几个原因。三个最突出的原因是成本、形状因子和光学属性。首先，让我们考虑成本：不影响光学性能的情况下封装图像传感器是一个昂贵的过程。直接将传感器芯片无封装地键合到PCB上可以节省封装成本，但带来了更高的组装/制造成本。在PCB上键合光学组件通常需要一个洁净室设置以及一个可键合的PCB表面处理。这两个选项都会增加制造成本，这就是为什么直接芯片贴装通常只适用于高体积或高度专业化的产品。 选择直接芯片贴装方法的另一个好理由是为了减少整体解决方案的高度，特别是在笔记本电脑或智能手机等密集集成的摄像解决方案中，Z轴上的每一分毫米都很重要。如果图像传感器的活动芯片在板面上方升高0.5mm，则额外的高度必须通过镜头组件来补偿。这通常导致整个图像传感器和镜头堆栈的厚度增加。 此外，镜头组件的安装便捷性是使用裸传感器芯片的另一个有力理由。为了获得无畸变的图像，传感器芯片必须与镜头组件轴线完全垂直。镜头组件是以PCB表面为机械参考的，该表面必须与图像传感器芯片完全平行。例如，如果图像传感器被封装为BGA组件，很难保证它与板面完全平行。这种效应需要通过镜头组件来补偿，但在直接芯片贴装方法中通常不存在这个问题。 对于我们的笔记本电脑设计，由于制造成本增加，直接将传感器芯片贴装到PCB表面不是一个选项。因此，我们将使用以细间距BGA组件形式封装的OV2740。 以BGA封装的OV2740图像传感器 图像传感器封装印记 传感器封装不是常规的BGA封装，而是一个多间距网格阵列。在我们的案例中，这意味着焊球在X轴和Y轴上有不同的间距： 图像传感器的BGA印记 截图显示，BGA印记在X轴上使用0.53mm的间距，在Y轴上使用0.48mm的间距。这对我们必须为电路板选择的PCB设计和制造技术有一些影响。大多数PCB提供商可以在标准工艺中制造0.1mm的走线宽度和间距。如果我们想选择标准设计规则而不为更高技术等级支付额外费用，我们只能在Y轴上打破传感器引脚： BGA元件引出 由于X轴的引脚间距略大，我们可以方便地在两个焊盘之间放置一条0.1mm的走线。如果我们想要同时引出X轴的第二排，我们需要选择0.09mm的走线间距，这是大多数制造商在他们的默认设计规则下无法处理的。 图像传感器有五排引脚，我们可以毫无问题地引出最外面的两排引脚。中间还有一排我们无法从顶层到达。在焊盘之间放置一个带有0.4mm焊盘和0.2mm钻孔的通孔（VIA）—大多数标准PCB设计规则的极限—不是一个选项，因为从VIA到焊盘的间距不够： 带有VIA的BGA足迹 此时，我们可以在PCB制造过程中使用一个额外的步骤，那就是堵塞和封顶VIA。通过使用封顶VIA，我们可以直接将VIA放置在焊盘上，而不会在PCB组装期间引起任何可靠性问题。 这样，图像传感器的逃逸布线可能如下所示： 阅读文章